|
心得:
1.要進行對稱式布局
2.SDRAM靠近BGA擺放 (中間無排阻時600-800mil,中間有排阻時800-1000mil)
3.數(shù)據(jù)信號線9根走一層(D0-D7 LDQM;D8-D15 HDQM)
4.信號線間距3w 數(shù)據(jù)線,地址線,時鐘線20mil以上
5.數(shù)據(jù)組誤差+/-50mil
6.地址、控制、時鐘誤差+/-100mil
7.濾波電容靠近ic管腳放置
8.空間允許下,在走線之間加一根地線(15-30mil)
AD 健-第4次作業(yè)-SDRAM的PCB設計.zip
(1.21 MB, 下載次數(shù): 2)
2020-10-24 17:24 上傳
點擊文件名下載附件
下載積分: 聯(lián)盟幣 -5
|
|