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[作業(yè)已審核] AD75 吳官勝 SDRAM作業(yè)

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發(fā)表于 2020-12-17 22:04:25 | 只看該作者 回帖獎(jiǎng)勵(lì) |倒序?yàn)g覽 |閱讀模式
學(xué)習(xí)心得:SDRAM芯片引腳分類
低八位數(shù)據(jù)組sdram_data_bus: D0~D7,LDQM
高八位數(shù)據(jù)組sdram_data_bus: D8~D15,HDQM
地址線,控制線,時(shí)鐘線設(shè)為一組: sdram_addr_bus
1片SDRAM布局原則:
  • 點(diǎn)對(duì)點(diǎn)的對(duì)稱式布局方式
  • SDRAM靠近BGA放置

       當(dāng)中間無排阻時(shí): 600-800mil
       當(dāng)中間有排阻時(shí): 800-1000mil(Bank中心距離)
  • 濾波電容靠近IC
2片SDRAM布局原則:
  • 相對(duì)于CPU對(duì)稱式布局
  • PCB板卡設(shè)計(jì)時(shí), 空間足夠時(shí),與CPU放在同一面,
  • PCB板卡設(shè)計(jì)時(shí),空間不足時(shí)(在做核心板的時(shí)候)SDRAM頂?shù)讓?duì)貼
布線原則:
  • 阻抗:50歐
  • 數(shù)據(jù)線每9根盡量走在同一層(D0~D7,LDQM;D8~D15,HDQM),其中每組數(shù)據(jù)線+/-50mil,
  • 信號(hào)線的間距滿足3W原則, 線之間的距離保持20mil以上或至少3W
  • 空間允許的情況下,應(yīng)該在它們走線之間加一根地線進(jìn)行隔離。地線寬度推薦為15-30mil
  • 地址線,控制線,時(shí)鐘線一起等長(zhǎng)誤差范圍+/-100mil




1片SDRAM的PCB設(shè)計(jì).zip

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發(fā)表于 2020-12-19 10:08:16 | 只看該作者
SDRAM模塊已經(jīng)評(píng)審?fù)戤,?qǐng)查看附件中的評(píng)審報(bào)告!

全能三期AD75吳官勝SDRAM模塊評(píng)審報(bào)告20201219.docx

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