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[文件已評審] 編號:20170920 PCB公益評審報告

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發(fā)表于 2017-9-20 10:04:17 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
您閱讀的評審報告自于凡億PCB QA評審組(www.fany-online.com)  m/ a& S0 l: t: t, ]# [1 H  j9 L/ J
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1 K  u, b1 ^0 e( T1.評審PCB全程保密不外發(fā),評審之后會進行文件刪除,介意者不要發(fā)送文檔!' U: d) Z+ y$ j7 t4 `8 t
2.評審報告只是局部截圖并添加文字說明,如需更詳細的請內容請聯(lián)系我們評審人員' ?  H# B3 v+ b. d# K9 \7 ^
3.評審意見僅供參考意見,由此造成的任何相關損失網站概不負責 。) Q* o* t0 }+ V8 e
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如果您的PCB需要評審,請以郵件的方式發(fā)送給我們,我們一般在1個工作日之內安排評審
' {) o; X6 m1 B1 O3 G1 o  y: p' n郵件格式:PCB公益評審+項目名稱
) o/ Q/ h& Q1 S郵件地址:pcbqa@fany-eda.com, y$ m4 L, W# K( U
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1、 繼電器絲印本體下所有層挖空處理,切斷干擾源
( Q* H! A& A  Y% m. _
& I0 I0 @. e3 `/ k2 O

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推薦
發(fā)表于 2017-9-20 10:16:09 | 只看該作者
評審建議:
6 r8 d; k; L9 l7 C! J4 S7 X5 Y4 k1:重新設定規(guī)則,銅皮采用全連接,銅皮到過孔的距離設置為5: X' c( B# I: G  M& g- p
2:給予主控部分,電源部分分別加屏蔽罩。
8 a0 v5 _; H3 n8 _3:修整電源,BGA出來的LDO加大,尤其是BGA的核心電源。) v9 y+ L) U' U( I& I2 ^9 h& r
4:調整DDR數(shù)據(jù)線和地址線的環(huán)路,減少環(huán)路面積,壓縮DDR范圍。
8 Q/ }: R: O% b9 D6 `/ A" k( i5:壓縮 DDR范圍后,將垮入DDR部分的其他信號線及電源挪走。: g* x- A: B# S: y& w
DDR部分不能有其他任何與DDR無關的信號,每層都是這樣的。  {; ?) t" L0 L7 }3 `' t$ W# q( S# L
6:其他的一些問題等整改完后,在看。先把這些致命問題整改好。
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沙發(fā)
發(fā)表于 2017-9-20 10:05:13 | 只看該作者
2、依照RK標準 這個地走粗點 20MIL,單點接地處兩個地孔.

0 |& t# H8 c* T1 r5 K8 l& v* P& R

1 o/ m$ V- P. D: w/ j, Q1 ^

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板凳
發(fā)表于 2017-9-20 10:05:44 | 只看該作者
3、DDR_GPU載留瓶頸只有這么多,GPU應該是大電流的,要大面積普通。TOP層輸出采用全連接吧,這樣可以加大載留面積的。
, E. j) I9 P# S  q$ t8 w$ H4 n3 ?( [

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地板
發(fā)表于 2017-9-20 10:06:15 | 只看該作者
4、多余的孔

" I8 E9 q! N0 J7 k, G0 V

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5#
發(fā)表于 2017-9-20 10:06:52 | 只看該作者
5、電感中間不要有銅皮
, k) ?  B' i1 l- k% F) B* G- k1 V5 M3 q

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6#
發(fā)表于 2017-9-20 10:07:27 | 只看該作者
6、輸入輸出孔不一致

  f* `; y7 ?( J1 O$ H7 y

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7#
發(fā)表于 2017-9-20 10:08:01 | 只看該作者
7、反饋要從輸出的最后一個濾波電容后 取電。另外GPU  CPU的濾波電容盡量靠近輸出端,這樣才有率效果。

, e, o8 y4 V! w+ x- Y( U

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8#
發(fā)表于 2017-9-20 10:08:34 | 只看該作者
8、DCDC的回流地采用 X交叉方式,輸出保證4個地孔以上(參看Layout指南)
' h8 O- B* g- }; Q5 v0 T

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9#
發(fā)表于 2017-9-20 10:09:31 | 只看該作者
9、IC引腳中間的地CUT# W) r9 l& X) R# M

7 t9 _& n" K4 t: ?( G

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10#
發(fā)表于 2017-9-20 10:10:09 | 只看該作者
10、PMU的輸入電源被割斷的太嚴重了,導致載留瓶頸很小
* U' h2 Z! r3 p4 S; j
: ]: z1 i, W& L. C) }# |: @; @

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