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[作業(yè)已審核] AD 健-第4次作業(yè)-SDRAM的PCB設(shè)計(jì)

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發(fā)表于 2020-10-24 17:34:23 | 只看該作者 回帖獎(jiǎng)勵(lì) |倒序?yàn)g覽 |閱讀模式
心得:
1.要進(jìn)行對稱式布局
2.SDRAM靠近BGA擺放 (中間無排阻時(shí)600-800mil,中間有排阻時(shí)800-1000mil)
3.數(shù)據(jù)信號線9根走一層(D0-D7 LDQM;D8-D15 HDQM)
4.信號線間距3w 數(shù)據(jù)線,地址線,時(shí)鐘線20mil以上
5.數(shù)據(jù)組誤差+/-50mil
6.地址、控制、時(shí)鐘誤差+/-100mil
7.濾波電容靠近ic管腳放置
8.空間允許下,在走線之間加一根地線(15-30mil)

AD 健-第4次作業(yè)-SDRAM的PCB設(shè)計(jì).zip (1.21 MB, 下載次數(shù): 2)


沙發(fā)
發(fā)表于 2020-10-26 09:39:04 | 只看該作者
SDRAM模塊已經(jīng)評審?fù)戤,請查看附件中的評審報(bào)告!

AD健SDRAM評審報(bào)告20201026.doc

322.11 KB, 下載次數(shù): 3, 下載積分: 聯(lián)盟幣 -5

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