為什么reg2cgate的setup難以滿(mǎn)足？

Reg2cgate的setup天生是難以滿(mǎn)足的，其中緣由是什么呢？通過(guò)下面一張圖大家便可以直觀的了解到。
    從圖上我們可以看出，clock gate的clock latency是delay1，reg1的clock latency是delay1+delay2，可以明顯的看出，reg2cgate的setup，其launch clock path delay天生是要比capture clock path delay要多delay2的，因此其setup相對(duì)于reg2reg是不好滿(mǎn)足的。


    根據(jù)setup的計(jì)算公式可以看出：
Launch_clock_path_delay +data_path_delay+setup_check
    我們將下圖中的一些值代入到上述公式可以得到：
(Launch_clock_path_delay - capture_clock_path_delay) + data_path_delay+setup_check
    所以為了解決reg2cgate的setup，我們可以降低delay2，delay3的值，delay3為data path delay，這個(gè)工具默認(rèn)是為去降低的。因此，能夠讓我們?nèi)ヌ幚淼木褪莇elay2的值。
    那么delay2的值是如何降低的呢？下面有幾種方法供大家參考。
    a. 在長(zhǎng)clock tree的時(shí)候，讓clock gate盡量貼近其后面的register，盡量不要在clock gate后面用插buffer的方式，去解clock gate的fanout。這么操作會(huì)導(dǎo)致delay2變大。如果clock gate的fanout特別大，可以去問(wèn)一下綜合人員是否可以?xún)?yōu)化一下netlist，或者我們?cè)陂L(zhǎng)clock tree的時(shí)候可以將clock gate clone選項(xiàng)打開(kāi)；
    b. 如果reg1與其他register沒(méi)有timing交互的話，可以在reg1的ck端設(shè)置ignore pin，這樣工具在長(zhǎng)clock tree的時(shí)候，便會(huì)將reg1的clock latency做短，即減少了delay2的值。
    那么，通過(guò)上述方法，基本上可以解決掉reg2cgate的setup問(wèn)題。
    另外，在innovus中，我們也可以在對(duì)reg2cgate創(chuàng)建group path，并對(duì)group path level設(shè)置一個(gè)較高的值。那么，工具在優(yōu)化的時(shí)候，會(huì)著重去優(yōu)化reg2cgate path。
    以上就是解決reg2cgate setup的原理和方法。

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