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[作業(yè)已審核] 高斐龍-常用存儲器設(shè)計-2片SDRAM菊花鏈)的PCB設(shè)計作業(yè)

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發(fā)表于 2024-7-14 13:46:13 | 只看該作者 |只看大圖 回帖獎勵 |倒序瀏覽 |閱讀模式
1、點對點的對稱式布局方式
2、SDRAM靠近BGA放置,當中間無排阻時:600-800mil,當中間有排阻時:800-1000mil(Bank中心距離)
3、濾波電容靠近IC管腳進行擺放
4.特性阻抗:50歐
5.數(shù)據(jù)線每9根盡量走在同一層(D0~D7,LDQM;D8~D15,HDQM)
6.信號線的間距滿足3W原則,數(shù)據(jù)線、地址(控制)線、時鐘線之間的距離保持20mi以上或至少3W空間允許的情況下,應(yīng)該在它們走線之間加一根地線進行隔離。地線寬度推薦為15-30mil4、
7.低八位數(shù)據(jù)組等長 誤差范圍+1-50mil
8.高八位數(shù)據(jù)組等長 誤差范圍+1-50mil
9.地址線,控制線,時鐘線一起等長 誤差范圍+/100mi

常用SDRAM存儲器模塊設(shè)計作業(yè).zip

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發(fā)表于 2024-7-25 16:19:09 | 只看該作者
鋪銅覆蓋焊盤中心

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