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[作業(yè)已審核] SDRAM--菊花鏈 & T--AD--冉彬彬--V1.PcbDoc

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發(fā)表于 2019-6-17 18:11:01 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
一點心得:
      1. 理解 T點 & 菊花鏈 概念
      2.BGA出線 (同組同層,遠(yuǎn)離2行焊盤扇出,電源孔都先保留后期再合并)          a.我是先從SDRAM 往BGA走 ,發(fā)現(xiàn)走不通
          b.我又從BGA往SDRAM走,發(fā)現(xiàn)有些繞,還比較丑。
          c.最后  最后  最后  我把SDRAM的孔,帶網(wǎng)絡(luò)復(fù)制到 BGA邊上,大致理順BGA的出線,把線路走通,再優(yōu)化線路 。

      3.間距滿足3W原則;數(shù)據(jù)線誤差范圍控制在±50mil;地址線誤差范圍控制在±100mil
          等長部分:先找出組中最長的線(不能再短了),其他線以此長度繞等長,如果發(fā)現(xiàn)空間不夠了,別慌,在不改變其他走線長度的情況下,上下平移or左右平移,推擠出空間在繼續(xù)。
                          注意一組線中中間的那根(先為其盡量預(yù)留繞等長空間)。
      4.等長走線 盡量咬合(類似 兩只手交叉握。┮簿褪 有兩條 兩條線 是并行的,
      5.理解并會模仿疊層 (幾層  各層介質(zhì)  厚度計算)

另 此圖已自查   !
@鄭振宇_Kivy   描述不足之處,還請多多指正 謝謝!

SDRAM-T-AD-冉彬彬-V1.PcbDoc

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發(fā)表于 2019-6-17 23:25:33 | 只看該作者
走線一定需要先從密的部分走向不密的部分
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發(fā)表于 2019-6-18 08:48:45 | 只看該作者
恩 知道了 謝謝!
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發(fā)表于 2019-6-18 11:21:58 | 只看該作者
設(shè)計做得很好  誤差等長方面基本OK
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