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[作業(yè)已審核] 第6次作業(yè)修改和第7次DM642達芬奇

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發(fā)表于 2021-5-1 16:08:08 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
本次學(xué)習(xí)時間練習(xí)有些長,請老師給予評審,TKS!

SDRAM_1_NEW.pcb

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SDRAM_2_NEW.pcb

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DM642-ZCpcb.pcb

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發(fā)表于 2021-5-7 15:38:53 | 只看該作者
SDRAM1
不滿足3W規(guī)則


DM642   整體做得不錯,比較整齊
1、避免這種打孔方式,2個孔之間保留一根線通過的距離

2、電源反饋線避開電感區(qū)域

3、電源信號鋪銅盡量做大一些,有空間就做寬一些

4、主電源供電路徑不足,加寬

5、電容應(yīng)挨CPU分布擺放,不能堆在一起

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