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[作業(yè)已審核] 高斐龍-1片SDRAM的PCB設(shè)計(jì)作業(yè)

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發(fā)表于 2024-7-11 23:56:57 | 只看該作者 |只看大圖 回帖獎(jiǎng)勵(lì) |倒序?yàn)g覽 |閱讀模式
1、點(diǎn)對(duì)點(diǎn)的對(duì)稱(chēng)式布局方式
2、SDRAM靠近BGA放置,當(dāng)中間無(wú)排阻時(shí):600-800mil,當(dāng)中間有排阻時(shí):800-1000mil(Bank中心距離)
3、濾波電容靠近IC管腳進(jìn)行擺放
4.特性阻抗:50歐
5.數(shù)據(jù)線(xiàn)每9根盡量走在同一層(D0~D7,LDQM;D8~D15,HDQM)
6.信號(hào)線(xiàn)的間距滿(mǎn)足3W原則,數(shù)據(jù)線(xiàn)、地址(控制)線(xiàn)、時(shí)鐘線(xiàn)之間的距離保持20mi以上或至少3W空間允許的情況下,應(yīng)該在它們走線(xiàn)之間加一根地線(xiàn)進(jìn)行隔離。地線(xiàn)寬度推薦為15-30mil4、
7.低八位數(shù)據(jù)組等長(zhǎng) 誤差范圍+1-50mil
8.高八位數(shù)據(jù)組等長(zhǎng) 誤差范圍+1-50mil
9.地址線(xiàn),控制線(xiàn),時(shí)鐘線(xiàn)一起等長(zhǎng) 誤差范圍+/100mi

1片SDRAM的PCB設(shè)計(jì)作業(yè).zip

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發(fā)表于 2024-7-25 15:40:14 | 只看該作者
先修線(xiàn)在等長(zhǎng),盡量縮短最長(zhǎng)線(xiàn)的長(zhǎng)度

截圖202407251539537448.png (163.06 KB, 下載次數(shù): 8)

截圖202407251539537448.png

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