編號(hào):20170907 PCB公益評(píng)審報(bào)告

PCBQA

您閱讀的評(píng)審報(bào)告自于凡億PCB QA評(píng)審組(www.fany-online.com)
+ U- _2 k. V% `6 U------------------------------------------------------------------------------------
使用前請(qǐng)您先閱讀以下條款:
" V5 q0 K5 T: t! E5 X  [1.評(píng)審PCB全程保密不外發(fā)，評(píng)審之后會(huì)進(jìn)行文件刪除，介意者不要發(fā)送文檔！
3 \. i/ L$ }& Y2 A* \% g2.評(píng)審報(bào)告只是局部截圖并添加文字說(shuō)明，如需更詳細(xì)的請(qǐng)內(nèi)容請(qǐng)聯(lián)系我們?cè)u(píng)審人員
3.評(píng)審意見(jiàn)僅供參考意見(jiàn)，由此造成的任何相關(guān)損失網(wǎng)站概不負(fù)責(zé) 。
, r7 z" u3 R$ m/ ?& s------------------------------------------------------------------------------------
如果您的PCB需要評(píng)審，請(qǐng)以郵件的方式發(fā)送給我們，我們一般在1個(gè)工作日之內(nèi)安排評(píng)審
郵件格式：PCB公益評(píng)審+項(xiàng)目名稱
0 i1 j! j0 k: Q4 g郵件地址：pcbqa@fany-eda.com
------------------------------------------------------------------------------------
2 n  \6 E* _9 M( ~1、USB為供電管腳 電源輸入主干道要加粗一般按照20mil過(guò)載1A電流進(jìn)行評(píng)估，目前是開(kāi)始時(shí)候大 但是后面變太小了不符合要求，表層過(guò)孔沒(méi)起作用可以刪掉
7 v; u$ j. [" o

PCBQA

2、這類(lèi)電源輸入輸出主干道分不清楚，造成走線、打孔出現(xiàn)問(wèn)題，第一腳為輸入  第5腳為輸出  第3腳 只是一個(gè)使能信號(hào)腳 走線10mil就夠了 不需要敷銅
' D9 w6 a* i0 ~) h, X/ g請(qǐng)優(yōu)化輸入和輸出管腳 過(guò)載大電流的，其他幾個(gè)不再一一指出 一樣的 請(qǐng)先理清楚輸入輸出
: z$ M) s8 @1 C

PCBQA

3、濾波電容的放置 非常差，請(qǐng)靠近管腳進(jìn)行放置，盡可能的近一些，走線先經(jīng)過(guò)濾波電容濾波之后再進(jìn)入IC管腳。
2 _( D7 y( N( v, G, W7 h; J8 E

PCBQA

4、SDRAM需要進(jìn)行等長(zhǎng)布線，走線間距不滿足3W原則 走線太近 ，請(qǐng)嚴(yán)格按照SDRAM相關(guān)規(guī)范進(jìn)行布局布線
$ I' y! J2 P$ O4 b+ C2 i- f
& h* d- Q3 S3 b4 K) {

PCBQA

1 Y! h) q7 p* ?6 c' l
5、平面分割問(wèn)題嚴(yán)重，存在過(guò)載通道太細(xì)，出現(xiàn)孤銅 無(wú)法載流的問(wèn)題，這個(gè)板子通過(guò)這種分割 核心電源無(wú)法滿足供電 板子跑步起來(lái)的

) z3 Y% m- \/ n& d7 I9 ^
* r* E4 Z3 b! Z# c4 B建議你看下凡億PCB四層核心板的Demo的設(shè)計(jì)：https://item.taobao.com/item.htm ... cju&id=536934512329
6 w0 @5 H- g5 i+ [( D. y很多問(wèn)題 這個(gè)視頻當(dāng)中都有進(jìn)行講解

PCBQA

6、關(guān)于晶體的濾波方式 請(qǐng)采用π型濾波方式，電容放在前面，注意其他地方也類(lèi)似檢查
3 A6 W9 L  r) \' J8 r
( v8 H: I# P' V( M+ \$ r% \

具體設(shè)計(jì)要求請(qǐng)參考以下內(nèi)容：

布局要求：

1、布局整體緊湊，一般放置在主控的同一側(cè)，靠近主控IC。

2、布局是盡量使電容分支要短（目的：減小寄生電容，）

3、晶振電路一般采用π型濾波形式，放置在晶振的前面。

布線要求：

1）走線采取類(lèi)差分走線；

2）晶體走線需加粗處理：8-12mil，晶振按照普通單端阻抗線走線即可；

3）對(duì)信號(hào)采取包地處理，每隔50mil放置一個(gè)屏蔽地過(guò)孔。

4）晶體晶振本體下方所有層原則上不準(zhǔn)許走線，特別是關(guān)鍵信號(hào)線。（晶體晶振為干擾源）。

5）不準(zhǔn)許出現(xiàn)stub線頭，防止天線效應(yīng)，出現(xiàn)額外的干擾。

7、繼電器為干擾源，請(qǐng)本體下面挖空處理。并且，走線需要加粗處理。

PCBQA

7、走線 請(qǐng)考慮 GND的回流問(wèn)題 考慮后期等長(zhǎng)的空間 考慮阻抗及串?dāng)_等問(wèn)題（3W），存在問(wèn)題太多 建議此版進(jìn)行重新設(shè)計(jì)
$ q9 g  F, ?# O. _, y+ U
8 q! P. L' c0 _

1625536570

非常給力的點(diǎn)評(píng)，避免出現(xiàn)類(lèi)似問(wèn)題

cesc

強(qiáng)烈支持PCB聯(lián)盟網(wǎng)網(wǎng)友資料分享，免費(fèi)資源就是給力！

bidinghong

非常給力的點(diǎn)評(píng)